通过FPGA在VOIP接收端恢复时钟的方法及系统

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通过FPGA在VOIP接收端恢复时钟的方法及系统
申请号:CN202511211293
申请日期:2025-08-28
公开号:CN120750481B
公开日期:2025-12-26
类型:发明专利
摘要
本发明公开了通过FPGA在VOIP接收端恢复时钟的方法及系统,涉及恢复时钟领域。具体公开了通过FPGA在VOIP接收端恢复时钟的方法,发送端将源时钟的下降沿传输的源数据打包成报文后传输到接收端;接收端提取报文中的源数据并存入接收缓冲区;根据接收缓冲区中数据个数的变化,采用时钟控制算法输出一个恢复时钟,通过该恢复时钟的上升沿输出接收缓冲区中的数据;时钟控制算法引入源时钟的数据传输速率和最大网络抖动时延。本发明能够提高时钟恢复的准确性和稳定性,解决了最大网络抖动时延的影响,同时降低了算法的运算规模。
技术关键词
接收端 数据 网络抖动 报文 时钟恢复 周期 发送端 时延 可读存储介质 计时器 控制模块 处理器 速率 计算机 电子设备 规模 存储器 算法